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capture CIS 原理图问题

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楼主
qooo71890800|  楼主 | 2014-3-6 12:55 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
CAPTURE, 原理图, cis, AC, ck
原理图库
1.为什么在生成异质封装时，在 Tools/Annotate，要把 {POWER_GROUND}改为{package}，直接在后面加入 package 属性不行吗？POWER_GROUND指什么属性。


2. 为什么将原理图手动改位号时，位号下面会多一横线，怎样删除？
   

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沙发
siyida| | 2014-3-7 11:40 | 只看该作者
在[allegro] capture CIS里，最好不要这样做，请找相关视频学习一下

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板凳
qooo71890800|  楼主 | 2014-3-7 17:53 | 只看该作者
不要这样做的意思是针对哪个动作？我是学于博士视频的啊，请指教。

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地板
pcbkey| | 2015-2-6 15:35 | 只看该作者
支持一下

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5楼
lifevast01| | 2016-5-25 14:11 | 只看该作者
楼主，你好，位号下面多一条横线我也遇到了，你是怎么解决的？

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