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[Verilog HDL]

VHDL和Verilog换行符

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楼主
0林心诚0|  楼主 | 2014-5-20 20:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
HDL, verilog, VHDL, verilo, hd
有没有哪位大神知道VHDL和Verilog的换行符，就是一句在一行里写不完，想写在多行里，用哪个符号连接？？

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沙发
0林心诚0|  楼主 | 2014-5-20 20:45 | 只看该作者
顶起来，希望大神能看到！！！！！！！

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板凳
yghanwuji| | 2014-5-20 22:30 | 只看该作者
直接回车就行了啊

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地板
0林心诚0|  楼主 | 2014-5-20 22:37 | 只看该作者
yghanwuji 发表于 2014-5-20 22:30
直接回车就行了啊

这样可以么？？？可能你没能理解我说的意思。一句完整的代码写在多行上，方便看。不是要把它从语法上拆成好几个小语句哇！！

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5楼
耗子-耗儿| | 2014-5-21 21:11 | 只看该作者
直接换行

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6楼
0林心诚0|  楼主 | 2014-5-21 21:36 | 只看该作者
耗子-耗儿 发表于 2014-5-21 21:11
直接换行

看来真的是直接换行，真心感谢哇

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7楼
520123| | 2014-5-22 18:15 | 只看该作者
顺易捷pcb打样48元起，韩先生服务热线13480101190

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