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UART时钟

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沙发
airwill| | 2014-5-28 07:28 | 只看该作者
这里 3 bit divider 应该是指3位除法分频器, 3组输出

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dannys0302|  楼主 | 2014-5-28 09:52 | 只看该作者
airwill 发表于 2014-5-28 07:28
这里 3 bit divider 应该是指3位除法分频器, 3组输出

我的意思是,像第二张图,有指出是哪个寄存器去设置的,但第一张图的没有指出

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FSL_TICS_Rita| | 2014-5-29 15:15 | 只看该作者
dannys0302 发表于 2014-5-28 09:52
我的意思是,像第二张图,有指出是哪个寄存器去设置的,但第一张图的没有指出 ...

楼主你好,关于你的第一个问题,2楼的朋友回答的是正确的,关于你提到的第二个问题中的PLL3是指的PLL3_main_clk,480M。第二个图中有寄存器可以设置,第一图中没有,说明第一个图中的频率没有办法修改,出来多少就是多少,而第二图中的是可以通过寄存器修改的。

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dannys0302|  楼主 | 2014-5-29 18:43 | 只看该作者
FSL_TICS_Rita 发表于 2014-5-29 15:15
楼主你好,关于你的第一个问题,2楼的朋友回答的是正确的,关于你提到的第二个问题中的PLL3是指的PLL3_ma ...

我下载的手册有点错误,clock tree的线连错了,把uart连到了PLL3的PFD1,换了个手册,看到UART的时钟是PLL3_main_clk的6分频,就是说图2中的PLL3应该是80M,谢谢各位

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FSL_TICS_Rita| | 2014-5-30 12:59 | 只看该作者
dannys0302 发表于 2014-5-29 18:43
我下载的手册有点错误,clock tree的线连错了,把uart连到了PLL3的PFD1,换了个手册,看到UART的时钟是PL ...

欢迎继续关注我们的论坛,有问题继续在这里交流哈:)~~

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