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FPGA 片间通信问题

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yangyang1|  楼主 | 2014-7-25 00:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, PGA, 通信
如题 求大神们指导一二

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沙发
habc987| | 2014-7-26 23:00 | 只看该作者
什么速率的，说详细些

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板凳
我的祖国| | 2014-8-19 19:50 | 只看该作者
看什么FPGA了

三个等级吧

1）用IO管脚直接连接 这个曾经做到过几兆的数据率 bits/s 简单，普遍能用。

2）用FPGA的差分管脚，这个硬件设计的时候要考虑匹配电阻，走线要一般50欧姆阻抗，这个速率看手册吧，具体没在FPGA间试过

3）如果FPGA够高端，带硬件LVDS的话，直接用模块。可以有现成的协议。但是挺贵的。

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地板
小计地盘| | 2014-8-20 17:14 | 只看该作者
很简单的问题，关键点有三：
1、片间时钟需要统一，如前级芯片的时钟需要传到后级
2、数据传输需要使用通信协议的方式加包头来防止数据出错
3、那就是fifo咯

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5楼
小计地盘| | 2014-8-20 17:15 | 只看该作者
我说的是pianjianzhilian

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6楼
habc987| | 2014-8-20 21:47 | 只看该作者
低速的话SPI接口即可

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7楼
bestray| | 2014-9-2 17:59 | 只看该作者
fpga片间通信么问题呀 ~·

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