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【CYPRESS 63813】端点0收发

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本帖最后由 yi373642635 于 2014-10-21 16:08 编辑

请教各位,目前项目中需要通过控制端点0来实现数据的收发,
芯片63813,工具工程PSoC Designer 5.4,
要求抓包如下图

实际抓包如下图,

发现两个问题,
1一直在查字符串描述,CTL响应有USTS错误;
2端点0的OUT方向可以识别到数据,但IN方向响应数据发不到总线上;

IN发送如下

        while(EP0MODE & 0x90)//(USB_bGetEPState(0) != IN_BUFFER_EMPTY)
        {}
        USB_LoadEP(0, pSendBuf, 0x8);

烦请各位帮忙分析指导~
沙发
kk5290122| | 2014-10-21 20:16 | 只看该作者
真心看不懂,帮顶!

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