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已经解决---关于i.MX6 DDR3的CLK连接疑问

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jiayong1913|  楼主 | 2014-12-4 13:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
本帖最后由 jiayong1913 于 2015-4-10 16:10 编辑

              目前,看到i.MX6的Demo板上DDR3的Layout采用了四片DDR3来做设计,拓扑方式采用的是T形拓扑,使用了两组CLK时钟连接信号 ,分别 是CLK0和CLK1,另外,我现在也采用了四片DDR3设计,拓扑方式使用Fly-by的方式来进行layout,所以,如果是按我所采用Fly-by的拓扑方式是否使用其中一组的CLK信号就可以了,而不用使用两组CLK信号连接???目前在i.mx6的相差硬件设计手册上也没有看到相关的描述,希望飞思卡尔相关FAE来解答一下,谢谢!

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沙发
FSL_TICS_Rita| | 2014-12-10 13:15 | 只看该作者
楼主你好,我前两天休假了,今天刚回来。帮你看一下哈,请耐心等待~~

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板凳
jiayong1913|  楼主 | 2014-12-19 15:04 | 只看该作者
FSL_TICS_Rita 发表于 2014-12-10 13:15
楼主你好,我前两天休假了,今天刚回来。帮你看一下哈,请耐心等待~~

另外,目前我把拓扑结构作了修改,修改成树型结构,四片DDR3放在同一面,不知道时钟线该怎么连??

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地板
FSL_TICS_ZJJ| | 2015-2-12 17:34 | 只看该作者
楼主你好
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Vitality1| | 2015-2-12 20:11 | 只看该作者
不是只有一组差分时钟吗,怎么有两组时钟

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6
ccw1986| | 2015-2-28 16:46 | 只看该作者
帮忙顶

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7
esyintao| | 2015-8-6 16:50 | 只看该作者
楼主你好,能分享一下树形结构和Fly-by拓扑CLK的连接方式吗?

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mini1986| | 2015-8-7 08:41 | 只看该作者
虽然是搞软件的,还是关注一下......帮你顶起来......

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