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FIFO时钟

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 楼主| 小敏敏 发表于 2015-1-24 15:06 | 显示全部楼层 |阅读模式
FIFO, 时钟, AD, DSP, 晶振
FIFO一端连接AD，一端连接DSP，读的时钟和DSP时钟相连，然后由于AD没有时钟输出口而是内部时钟，麻烦问一下，就是写的时钟能不能不从AD引入，而是另外从晶振出来的，用同一频率。
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sanxinwei 发表于 2015-1-24 15:21 | 显示全部楼层
学习了  
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xuyaqi 发表于 2015-1-25 13:51 | 显示全部楼层
要说明具体芯片
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GavinZ 发表于 2015-1-26 11:55 | 显示全部楼层
可以。
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