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DSP数据缓冲,能否用SDRAM代替FIFO?

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shimx|  楼主 | 2015-2-27 19:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
dengdc| | 2015-2-27 19:46 | 只看该作者
不行

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板凳
heweibig| | 2015-2-27 19:47 | 只看该作者
我有个问题,ADC或DAC和DSP相连接时,要注意什么问题?

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地板
heweibig| | 2015-2-27 19:48 | 只看该作者
比如匹配问题,以保证A/D采样稳定或D/A码不丢失。

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shimx|  楼主 | 2015-2-27 19:49 | 只看该作者
1. 接口方式:并行/串行;2. 接口电平,必须保证二者一致。

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heweibig| | 2015-2-27 19:50 | 只看该作者
哦,多谢楼主,呵呵

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7
wuhany| | 2015-2-27 19:51 | 只看该作者
SDRAM与SRAM的区别是,在读写的时候,SDRAM的延时非常长,需要几个CLOCK。
并且中间需要刷新。

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8
jiahy| | 2015-2-27 19:51 | 只看该作者
在读写的时候,SDRAM的延时非常长,需要几个CLOCK。中间需要刷新。所以是不行的

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9
lizye| | 2015-2-27 19:52 | 只看该作者
应该不可以   虽然没做过   但感觉二者之间有差别   你可以在看看手册

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10
zhenykun| | 2015-2-27 19:54 | 只看该作者
不行啊,绝对的

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shimx|  楼主 | 2015-2-27 19:55 | 只看该作者
结贴了,大伙晚安

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edishen| | 2015-2-28 18:20 | 只看该作者
这两个肯定是不能等同的  

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quray1985| | 2015-2-28 20:06 | 只看该作者
SDRAM没有SRAM速度快吧

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gaoyang9992006| | 2015-2-28 20:11 | 只看该作者
肯定不可以吧?

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