EPM7128S的IO脚与74LVT16245连接的问题

[复制链接]
3549|0
 楼主| aray2000 发表于 2007-3-10 12:35 | 显示全部楼层 |阅读模式
<br /><br />在我的电路中,用CPLD芯片EPM7128S来扩展ARM44B0的IO口,<br />其中EPM7128直接与74LVT16245的A&nbsp;PORT连接,<br />EPM7128的VCCIO用3.3V供电,VCCINT用5V供电,<br />74LVT16245是3.3V供电,其接口能兼容5V的信号,<br />打算采用CPLD的输出来控制74LVT16245的OE,&nbsp;DIR脚,<br />同时74LVT16245的A&nbsp;PORT上全部连接CPLD剩余的其它IO引脚。<br /><br />现在问题是,没焊上74LVT16245之前,EPM7128S工作正常。<br />但是焊上74LVT16245之后,EPM7128明显有点烫手……<br />不知道这是什么原因造成的?<br /><br />另外,EPM7128S的DATASHEET提到&nbsp;开漏输出选项(Open-Drain&nbsp;Output&nbsp;Option)<br />具体应该在哪里可以选用此选项?是在&nbsp;Quartus&nbsp;II的PIN&nbsp;PLANER里面设置管脚的IO&nbsp;STANDARD里设置吗?<br />在IO&nbsp;STANDARD里面可以选择IO口的电平类型有:TTL,&nbsp;LVTTL,&nbsp;LVCMOS&nbsp;
您需要登录后才可以回帖 登录 | 注册

本版积分规则

8

主题

8

帖子

0

粉丝
快速回复 在线客服 返回列表 返回顶部