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FIOXCLR=1<<Y，偶尔不能拉低端口

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jinqiankun|  楼主 | 2015-5-13 19:37 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
端口, IO, se
大家有没有遇到过这样的问题：
FIOXSET=1<<2;
...
...
...
FIOXCLR=1<<2;
上面不停循环，且SET和CLR进行同样多的次数后，偶尔会出现对应的端口输出高电平。

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