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[FPGA] FPGA控制SJA1000完成初始化后发送任何数据都会导致总线错误

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 楼主| 杨朔 发表于 2020-8-28 16:07 | 显示全部楼层 |阅读模式
控制, FPGA, sja1000, 总线, TI
本帖最后由 杨朔 于 2020-8-28 17:07 编辑

SJA1000使用PELICAN模式，外部24m时钟，TIM0,TIM1分别为00,18，初始化完成后SR寄存器会保持一段时间3c后回到0c状态，此时发送can数据帧，sja1000回报总线错误，start frame error,求解
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