[应用相关] ADC采样率超过推荐值有什么影响啊?

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理想阳 发表于 2024-5-7 00:04 | 显示全部楼层
事实上,这种配置并不重要,一般按照自己的需要来做吧
V853 发表于 2024-5-8 08:24 | 显示全部楼层
通常很难达到最大采样率
digit0 发表于 2024-5-8 22:10 | 显示全部楼层
较高的采样率意味着需要更多的数据带宽来传输和处理采样数据,这会给后续的数据处理带来压力。
LinkMe 发表于 2024-5-21 14:17 | 显示全部楼层
什么是官方推荐的采样率,只要你在 ADC 范围内,采样率不会影响准确性
Pretext 发表于 2024-6-4 21:11 | 显示全部楼层
没有,只要交流参考电压不漂移,数据采样率合理,基本上就不会有问题
天天向善 发表于 2024-6-6 23:36 | 显示全部楼层
ADC采样率超过推荐值时,可能会导致信号失真、噪声增加或系统稳定性下降。因此,选择合适的采样率非常重要,需根据实际需求和应用场景进行配置。
鹿鼎计 发表于 2024-6-9 11:55 | 显示全部楼层
空调的分辨率可能会降低,导致量化噪声增加,从而降低整体的测量精度。
LLGTR 发表于 2024-7-1 23:02 | 显示全部楼层
一般不宜,建议以速度为宜
caigang13 发表于 2024-7-2 08:29 来自手机 | 显示全部楼层
过采样呗,实际速率跑步上去。
芯路例程 发表于 2024-7-7 22:45 | 显示全部楼层
增加采样率通常会导致交流电的功耗增加,从而影响到系统的热管理和能源效率
LEDyyds 发表于 2024-7-9 17:01 | 显示全部楼层
肯定会不准啊
zhjb1 发表于 2025-6-15 08:57 | 显示全部楼层
本帖最后由 zhjb1 于 2025-6-15 08:59 编辑

AT芯片的ADC采样率范围挺宽的,我做过较快的1.5,7.5,13.5三个较快的测试比较,在1.5时,5路12位ADC采样就较为明显的跳动大约在+-20个之间跳动;采用7.5时跳动在+-3个左右或更低;在13.5以上基本是个位在偶尔跳动,数值再大可以说在有限个采样过程数据稳如“老狗”。因此常规采样周期设为:7.5——ADC_SAMPLETIME_7_5。
说明:板子自己设计的实验板,芯片AT32F407VGT7,主频240MHz,带有XMC驱显,5路EXTkey中断,3路PWM输出,等常规各种模块的开启,都运行时ADC的变化如上述。但如果将串口LCD显示连接线靠近ADC的输入连接线时,跳动会加大一点。说明线路优化布局十分有意义。
照片没有意义,视频发表太麻烦,不是必须就文字表述就可以了。
顺便说一句,我非常喜欢测试各种芯片,如有更高端的芯片或开发板等给我试用会给一些有益的测试结果的,仅此。
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