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小弟刚开始接触VHDL，FIFO程序有点问题
FIFO ，VHDL ，Reset ，se ，PROCESS
FPGA论坛 luoyelq 2012-3-22 8 2416 GoldSunMonkey 2012-4-16 18:07
我是初学者，求一VHDL电子版教材
HDL ，VHDL ，电子 ，hd
EDA 技术 k33334455 2008-1-27 8 3899 ic00 2009-11-29 10:51
vhdl的电路设计
VHDL ，电路设计 ，信号 ，电平 ，编程
EDA 技术 h495093331 2013-7-9 8 2038 q728117579 2013-9-4 16:36
关于 vhdl 的问题
VHDL ，PROCESS ，ce ，进程
ZLG 徐若瑄 2009-3-3 8 2776 徐若瑄 2009-3-10 10:22
ddr2求助
DDR ，ST ，Constraint ，VHDL ，HDL
FPGA论坛 千里风123 2012-11-6 8 3125 千里风123 2012-11-7 08:42
VHDL实现移相问题。。
VHDL ，移相 ，时钟 ，hz
EDA 技术 qingcaihui 2007-4-16 8 3456 qingcaihui 2007-4-30 00:16
跪求VHDL输出高阻态问题！在线等待
VHDL ，ST ，logic ，ic ，se
EDA 技术 xiubing65 2008-8-19 8 5923 xiubing65 2020-11-24 19:23
GSM给您一个能用SPI模式的SD读卡程序（VHDL） attachment digest
SPI模式 ，GSM ，VHDL ，sd ，TE
FPGA论坛 GoldSunMonkey 2012-8-21 8 4082 ifpga 2013-4-1 15:41
用Verilog好呢，还是VHDL
verilog ，VHDL ，CPLD ，PLD
EDA 技术 liu_huan 2007-9-3 8 3321 端木 2007-9-13 22:00
verilog HDL 与 VHDL的区别
verilog ，VHDL ，VerilogHDL
EDA 技术 51xlf 2013-3-6 7 11840 elec921 2013-3-21 08:32
求帮忙看一下这个原理图写的vhdl为什么不一样 attach_img
原理图 ，VHDL ，ST ，logic ，ic
FPGA论坛 洛杉矶been 2019-5-24 7 1439 zhangmangui 2019-5-26 21:19
VHDL中的库是什么
VHDL ，ST ，IEEE ，ic ，logic
ZLG 3B1105 2011-10-12 7 5677 xlhtracy 2011-11-29 16:23
Verilog和VHDL的问题
verilog ，VHDL ，FPGA ，PGA ，vhdl语言
FPGA论坛 wangch_sh 2014-8-24 7 1877 zhulin 2014-9-1 13:43
vhdl菜鸟的初问
HDL ，VHDL ，hd ，RS ，se
EDA 技术 52mcu 2008-1-15 7 2672 yuhongwei 2008-11-21 18:09
关于VHDL编写的乘法器的问题
编写 ，VHDL ，乘法器 ，logic ，ic
ZLG ycdianziguan 2009-2-20 7 2918 孤独行者 2009-10-25 10:35
用altium编辑VHDL文件 中文注释重叠 attach_img
Altium ，VHDL ，AC
EDA 技术 伯牙绝弦 2013-4-22 7 2328 伯牙绝弦 2013-4-28 00:08
急！VHDL中的时间描述
VHDL ，FIFO ，Reset ，se
EDA 技术 jewson 2009-8-10 7 2670 hq190725 2009-8-10 23:11
浅谈VHDL/Verilog的可综合性以及对初学者的一些建议
VHDL ，verilog ，代码 ，硬件 ，软件
FPGA论坛 nan678 2010-8-26 7 2777 dianzirobot 2011-5-17 23:50
转载一篇好文: VHDL 编程的一些心得体会
VHDL ，编程 ，信号 ，端口 ，进程
FPGA论坛 SuperX-man 2010-11-1 7 3591 lhm240393807 2011-4-12 20:16
VHDL学习理解
VHDL ，信号 ，端口 ，进程 ，buffer
FPGA论坛 strouledfox 2012-12-28 7 2453 yang4133 2013-1-4 06:42
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