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MIg生成ddr2时序约束问题

2015-11-2 18:32

FPGA论坛
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10091

请问楼主最后怎么解决的

生成bit流时incompatible due to VCCO mismatch

2015-8-17 23:15

FPGA论坛
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请问后来怎么解决的，我也遇到了这个问题

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