cadence不能保存自建焊盘
2014-10-22 22:50
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BOTTOM层是我在做示意图的时候搞错了,将PASTMASK_TOP加大后在检查就没有报错了。谢谢大家! ...
在用cadence创建自建焊盘的时候 保存时提示错误:error:save error -3000289 , ...
VHDL和Verilog换行符
2014-5-22 18:15
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3g模块使用问题
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CPLD 综合问题
2013-11-29 23:56
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2023-3-16 16:35
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画了第一块PCB,不知需要修改哪些地方,恳请前辈拍砖
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PCB板 本着重新画的心态 求大侠指正!
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外部供电输入是-48V,电源系统该如何设计?
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