Spartan-3E Starter Kit新手快速入门FPGA ISE实验
2013-3-5 22:14
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感谢分享
《Xilinx可编程逻辑器件设计与开发（基础篇）》连载30：
2013-1-25 14:09
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Chipscope信号无法找到的解决方案
2014-3-24 11:27
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/* synthesis syn_keep = 1 */
是什么意思啊 新手不懂
【转】ISE工程文件的管理--如何建立一个最小工程
2013-1-28 09:03
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我觉得很有用
GSM给您聊聊XST和Synplify Pro综合结果的区别（完成）
2013-1-30 10:10
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猴哥的东西值得认真研究！
Xilinx 常见问题及答案
2013-2-28 19:16
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谢楼主分享
GSM教您怎么在ISE查看各个模块消耗的资源
2019-4-11 14:39
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学习了
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ISE综合选项Keep Hierarchy
2013-1-25 14:10
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学习了
FPGA入门之我见
2019-12-4 12:10
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FPGA 探索路上。。
xilinx的约束实现（1）
2013-1-28 20:57
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谢谢分享
ISE约束文件的基本操作
2013-1-28 21:09
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图片不好看呐
针对赛灵思ISE工具的verilog编程经验小结
2013-1-28 21:08
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谢谢楼主
verilog学习五点经验分享
2017-4-16 18:24
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期待系统结构设计方面的指导
如何设置多周期路径
2013-3-26 22:03
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添加时序约束的技巧分析
2021-8-17 16:17
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新手。。在学这方面，还不太懂，copy下来慢慢研究喽。
先COPY...
Xilinx FPGA设计约束的分类
2013-1-30 22:55
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领奖截止日期：2月28日，大家早点啊
2013-2-22 16:01
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