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MKL16Z在VLPR模式下电流有1.14ma?

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沙发
FSL_TICS_Jeremy| | 2015-12-9 13:43 | 只看该作者
没有144uA那么低的。

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板凳
zhhaisheng|  楼主 | 2015-12-9 14:20 | 只看该作者

但1.14ma也太高了吧?我用的外部4MHZ晶振。

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地板
fclmyl2| | 2015-12-9 14:29 | 只看该作者
其它不用的IO不要定义 ,1MA高了

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5
FSL_TICS_Jeremy| | 2015-12-9 14:43 | 只看该作者
zhhaisheng 发表于 2015-12-9 14:20
但1.14ma也太高了吧?我用的外部4MHZ晶振。

1.14mA高了,请确认所有的外围功能模块时钟关闭,包括不要配置未使用的I/O引脚

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6
zhanzr21| | 2015-12-9 14:46 | 只看该作者
你把测量电流的方式贴出来看看

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7
zhhaisheng|  楼主 | 2015-12-9 15:02 | 只看该作者
测量电流的方式没有问题,直接在MCU的电源脚串入电流表测量的。

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8
zhhaisheng|  楼主 | 2015-12-9 15:04 | 只看该作者
FSL_TICS_Jeremy 发表于 2015-12-9 14:43
1.14mA高了,请确认所有的外围功能模块时钟关闭,包括不要配置未使用的I/O引脚 ...

所有的外围模块时钟关闭,IO口的时钟也关闭。手册上说明用外部4MHZ晶振的电流应该不超过300ua。

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9
zhanzr21| | 2015-12-9 16:28 | 只看该作者
zhhaisheng 发表于 2015-12-9 15:02
测量电流的方式没有问题,直接在MCU的电源脚串入电流表测量的。

好几个VDD VDDA 你怎么串的
你应该是串在LDO的输入那里吧
LDO自己消耗的你算没有
板子上还有没有别的器件?

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10
zhanzr21| | 2015-12-9 16:38 | 只看该作者
更正一下 有可能串在LDO的输出到各个VDD VDDA之间的 我是问板子上还有没有别的器件

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11
C洛达尔多| | 2015-12-9 20:28 | 只看该作者
不用的IO设置成三态

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12
zhhaisheng|  楼主 | 2015-12-10 09:27 | 只看该作者
本帖最后由 zhhaisheng 于 2015-12-10 09:29 编辑

按照MKL16的datasheet手册提供的数据在 BLPI 时钟模式时,手册数据:I_vlpr模式电流范围为185~352uA/3.0V。现在调试情况是如果在while(1)函数里全为“NOP();”,电流在217uA基本符合手册数据。但只要调用一个函数,即使是空函数电流就会上升到650uA,为什么调用一个函数电流就上升了400uA?不知道这是为什么?

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13
21ic小管家| | 2015-12-10 17:12 | 只看该作者
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