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用Python开发CPLD
2016-12-15 16:23
FPGA论坛
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1798
python和Verilog是两种不同的语音范畴,python是一种脚本,可以根据自己的理解来生成verilog文件,但是前 ...
支持一个!python只是学了皮毛,主要用在Linux下进行一些资料处理(ASIC设计)!可以跟你一起探讨学习! ...
很好的IC设计学习资料:数字前端设计案例
2014-12-13 21:00
EDA 技术
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8866
楼主,还有没有其他资料?
谢谢楼主分享!
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