fpga 如何将普通IO口当串口用
2014-7-5 14:41
- FPGA论坛
- 4
- 1674
看你另一端是什么格式的？我一般做的都是8位并口信号转异步串口。
如何给IP核RAM加一个使能引脚？
2014-6-27 15:19
- FPGA论坛
- 1
- 1113
1、首先选通是什么意思？我的理解是选通就是RAM有输出，不选通就是没输出。你的程序看起来选通是选择不同的 ...
Verilog的按键消抖与松手检测如何做到，求给个思路
2014-6-30 09:03
- FPGA论坛
- 8
- 3462
松手我那个程序里也有啊，既有从高到低，也有从低到高的检测。
上面就是一个简单的去抖动程序。
时钟的频率和去除抖动的时间自己根据产品实际确定。
程序的思路简而言之， ...
module remove
(
input rst_n,
input clk,//64KHz
input in,
output reg out
);
param ...
晒晒新做的CYCLONE IV核心板 EP4CE15 共享原理图和测试程序
2024-8-9 09:59
- FPGA论坛
- 1494
- 145886
正好想学习CYCLONE IV的原理图。
调用了cyc4内部乘法器，怎么内部乘法器使用率还是0%啊？
2014-6-26 10:09
- FPGA论坛
- 1
- 967
应该是自动调用的。
有一种情况是乘法的结果没有被使用，综合的时候忽略了。相关源代码贴出来啊 ...
有ALTERA RapidIO经验的高手请进
2019-5-9 19:01
- FPGA论坛
- 10
- 3904
能，我现在做的产品已经实现了
还是自己回复吧。
就是drbell_s_chipselect和drbell_s_write（或者drbell_s_drbell_s_read）必须全拉高才能 ...
不知为何,从上电开始，还没有进行任何操作，drbell_waitrequest信号始终为高。这个状态实在SignalTap里看见 ...
FPGA使用资源问题？
2013-8-9 15:16
- FPGA论坛
- 15
- 1597
华为FPGA设计高级技巧Xilinx篇
2012-9-9 11:47
- FPGA论坛
- 13
- 1927
实际功耗大于datasheet上标注值
2012-1-18 23:54
- FPGA论坛
- 5
- 2076
VC5510外部存储器的读写问题
2012-8-18 10:55
- 德州仪器MCU
- 10
- 2990
为什么使用QUARTUS II编译不生成.SOF文件？
2012-8-26 11:01
- EDA 技术
- 3
- 17014
添加时序约束的技巧分析
2021-8-17 16:17
- FPGA论坛
- 30
- 6951
求TMS320C25汇编语法手册
2015-1-27 23:47
- 德州仪器MCU
- 4
- 940
2
3
近期访客