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FPGA的引脚定义有什么要求吗？

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楼主
tianyi1028|  楼主 | 2011-5-19 15:58 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, 引脚定义, 信号, 原理图
在画原理图时，看到很多例子就是引脚都不是按顺序排的，那么在排列引脚时有什么要求或者说是规则吗？另外在对引脚加信号时有什么要求或者规则吗？

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沙发
AutoESL| | 2011-5-19 21:46 | 只看该作者
顶

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板凳
明空| | 2011-5-20 10:48 | 只看该作者
看PCB布线方便

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地板
tianyi1028|  楼主 | 2011-5-20 12:53 | 只看该作者
3# 明空

就这些没别的了？确定吗？

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5楼
heitai| | 2011-5-20 20:23 | 只看该作者
如果仅应用为普通高低电平，在参考电平相同时，引脚可以随意分配，不过时钟最好接FPGA专用全局时钟，当然不接也可以

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6楼
linas| | 2011-5-20 21:29 | 只看该作者
原来如此。

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7楼
sxhhhjicbb| | 2011-5-20 21:35 | 只看该作者
"在画原理图时，看到很多例子就是引脚都不是按顺序排的"
估计LZ问的是原理图为什么和PCB的封装不同顺序。
原理图只是符号。

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8楼
SuperX-man| | 2011-5-21 10:00 | 只看该作者
Lz如果你想线走的好看点的话.可以PlanAhead工具来手动布..

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9楼
ty新气象| | 2011-6-24 15:29 | 只看该作者
学习了。

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10楼
wewo| | 2011-6-24 22:20 | 只看该作者
超人说的对

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11楼
amini| | 2011-6-24 22:58 | 只看该作者
明白了。谢谢。

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12楼
hzwhg001| | 2012-11-8 17:29 | 只看该作者
顶！

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13楼
GoldSunMonkey| | 2012-11-8 21:52 | 只看该作者
;P

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14楼
gaochy1126| | 2012-11-8 23:37 | 只看该作者
最起码得等长度，要不信号容易错误的吧

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15楼
Backkom80| | 2012-11-9 07:58 | 只看该作者
xilinx 的　planahead可以帮助设计人员解决IO的分配，参见如下：
https://bbs.21ic.com/frame.php?fr ... com/iclist-120.html

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16楼
GoldSunMonkey| | 2012-11-9 22:47 | 只看该作者
xilinx 的　planahead可以帮助设计人员解决IO的分配，参见如下：
https://bbs.21ic.com/frame.php?frameon=yes&referer=https://bbs.21ic.com/iclist-120.html
Backkom80 发表于 2012-11-9 07:58
开始显摆自己了。;P

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17楼
薇儿安蓝| | 2013-1-31 09:32 | 只看该作者

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18楼
loansat| | 2013-1-31 09:36 | 只看该作者

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