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[应用方案] 芯圣芯片 SPI 从机模式，NSS 软件控制延迟多久合适？

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xdvca 发表于 2025-8-28 21:42 | 显示全部楼层 |阅读模式
将芯圣芯片设为 SPI 从机，与主机通信时，硬件 NSS 控制出现丢包。
改成软件控制 NSS 后，在主机拉低 NSS 后，从机延迟 1us 读 RBNE 标志，丢包问题解决。
不过不同的通信速率和硬件环境，这个延迟时间可能需要调整。
大家在实际开发中，是怎么确定这个延迟时间的最佳值的？



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