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[FPGA] 假期来玩cadence，bug记录

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 楼主| 战将之斧 发表于 2022-1-31 12:53 | 显示全部楼层 |阅读模式
AD, UG, ce, cadence, BUG, 原理图
不知什么原因，原理图库管脚长度都变成了0，还堆在了一起，cadence也有这事儿；从原理图里从新保持了一遍；

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wooda 发表于 2022-2-11 23:43 | 显示全部楼层
没前没后的，没法判断是啥情况。。。
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