[MCU] TI多核SoC架构有什么优越性

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 楼主| jiaxw 发表于 2019-9-15 10:19 | 显示全部楼层 |阅读模式
TI多核SoC架构有什么优越性
yszong 发表于 2019-9-15 10:21 | 显示全部楼层
运行频率高达1.2GHz
wuhany 发表于 2019-9-15 10:29 | 显示全部楼层

引擎性能高达256GMACS和128GFLOPS
zhaoxqi 发表于 2019-9-15 10:31 | 显示全部楼层
比TI同系列上一代DSP产品性能高出10倍
huangchui 发表于 2019-9-15 10:35 | 显示全部楼层
比竞争对手最新发布的DSP性能高5~6倍。
shimx 发表于 2019-9-15 10:38 | 显示全部楼层
此外,该多核SoC每个DSP内核同时支持了定点和浮点处理功能
yszong 发表于 2019-9-15 10:42 | 显示全部楼层
集成浮点处理功能对于基站、视频的算法,效率比定点处理高4~5倍,浮点处理对性能有大幅的提升。
zhaoxqi 发表于 2019-9-15 10:44 | 显示全部楼层
对于客户而言,开发先进的浮点处理需要耗费大量的时间。许多工程师开发信号算法先使用浮点处理,经过测试验证之后通过定点化来优化程序。现在TI的多核SoC集成浮点和定点处理,工程师无需再将算法定点化,大约可以节省3个月的研发时间。
huangchui 发表于 2019-9-15 10:50 | 显示全部楼层
作为一个整体的系统,多核之间的互联也是非常重要的一部分。
jiajs 发表于 2019-9-15 10:53 | 显示全部楼层
首先,多核导航器,从硬件层次上把任务分发到各个内核内存上。其次为高速芯片级网络化交换架构,每秒可达2兆兆位的数据交互,可以保证主干网无阻塞。
yszong 发表于 2019-9-15 10:56 | 显示全部楼层
第三为多核共享内存控制器,可直接访问内核内存,避免读取数据造成时延,保证多核的性能。第四Hyperlink提供芯片级一个高速接口,以便芯片外扩展加速器,使整个SoC更强大。第五针对相应的应用有硬件加速的协处理器。
zhanghqi 发表于 2019-9-15 11:23 | 显示全部楼层
应该同时还推出了高效的支持工具吧
zhenykun 发表于 2019-9-15 11:32 | 显示全部楼层
C6x编译器是在成熟的CCS编译器基础上增加了多核的支持,现有的客户可以充分利用多核性能。“让客户单次投资开发macro、pico、femto基站,并可以用C+、C++快速修改。”Ramesh Kumar表示软件的易用性也是TI多核SoC设计架构的优势之一。
wyjie 发表于 2019-9-15 11:35 | 显示全部楼层

此外,Jump Start软件可以提供客户跳跃式的开发,而无需从零开始,该软件库涵盖了通信领域包括GSM-EDGE、WCDMA、HSPA、WiMAX以及LTE等,还囊括了语音、视频、编解码器等基本的标准算法。
dengdc 发表于 2019-9-15 12:00 | 显示全部楼层
片上交换架构——TeraNet 2 的速度高达每秒 2 兆兆位,可为所有 SoC 组成部分提供高带宽和低时延互连
 楼主| jiaxw 发表于 2019-9-15 12:04 | 显示全部楼层
了解了,多谢大家
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