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CPLD译码求助

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 楼主| 2287312853 发表于 2019-11-20 23:20 来自手机 | 显示全部楼层 |阅读模式
CPLD, 译码, DSP, constant, 74ls13
目前在自学cpld，dsp（f28335）连接到cpld的地址线是XA0-XA12,共13根地址线,有哪位大神能够指点下，CPLD怎么译码dsp传输下来的地址，我做时，使用了常数发生器IPM_CONSTANT[15..0],与XA3-XA12与XZCS0利用或非门做了使能线（高使能），XA0,XA1,XA2作为地址线译码，类似与74ls138译码器原理，dsp映射到cpld寻址空间为XZCS0，请问这样做对吗，请指教，谢谢！
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zchong 发表于 2019-11-21 07:23 来自手机 | 显示全部楼层
地位地址线译码？目的是译着玩？还是啥特殊用途
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tyw 发表于 2019-11-21 08:46 | 显示全部楼层
本帖最后由 tyw 于 2019-11-21 09:11 编辑

Altera FPGA_CPLD设计 高级篇.pdf
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 楼主| 2287312853 发表于 2019-11-21 22:41 来自手机 | 显示全部楼层
zchong 发表于 2019-11-21 07:23
地位地址线译码？目的是译着玩？还是啥特殊用途

dsp通过给cpld发出信号控制外部接口，也就是说，dsp传输的地址经过cpld译码后才能被识别，现在我的问题是这个译码器该怎么设计，谢谢！
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zchong 发表于 2019-11-22 07:28 来自手机 | 显示全部楼层
本帖最后由 zchong 于 2019-11-22 07:29 编辑
2287312853 发表于 2019-11-21 22:41
dsp通过给cpld发出信号控制外部接口，也就是说，dsp传输的地址经过cpld译码后才能被识别，现在我的问题是 ...


那你就按38译码不行吗？或者说你要把3bit的地址译成什么？
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