System Generator Clock Enable Logic Optimization

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 楼主| AutoESL 发表于 2011-4-22 15:41 | 显示全部楼层 |阅读模式
本帖最后由 AutoESL 于 2011-10-3 09:07 编辑

§Multi-rate design in System Generator

§Clock enable hardware

§Phase of clock enables in relation to the original Simulinksimulation

§Optimizing Clock Enable fanout

§Resetting the auto-generated clock enable logic

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奔腾2.0 发表于 2011-4-22 22:47 | 显示全部楼层
:dizzy:
 楼主| AutoESL 发表于 2011-4-23 11:50 | 显示全部楼层
hjjnet 发表于 2011-4-23 13:21 | 显示全部楼层
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个人签名:天使宝贝 博客IT人生 From C/C++/SystemC to Xilinx FPGA

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