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触发器D2的建立时间T3和保持时间应满足什么条件?

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 楼主| kaloulin 发表于 2018-9-11 12:22 | 显示全部楼层 |阅读模式
触发器, 寄存器, 时钟, 电路, 组合逻辑电路
时钟周期为T,触发器D1的寄存器到输出时间（触发器延时Tco）最大为T1max，最小为T1min。组合逻辑电路最大延迟为T2max,最小为T2min。问，触发器D2的建立时间T3和保持时间应满足什么条件?
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