好**，大家参与，！

发表于 2008-4-10 15:58

我也是初学，大家一起学习！

发表于 2008-4-10 18:58

21楼的分析有道理，OSCtxSw和OSIntCtxSw中理应保护R4和R5，加上之后就可以用不同的优化级别，运行时也不会挂起了。

发表于 2008-4-10 23:53

这里确实有可能会改变，难怪我使用最佳优化就会挂掉，学习了！请下载了的tx将此处修改！

发表于 2008-4-11 10:52

其实Micrium官方已经出过一个修正(AN-1018)，大概大家都没注意到而已。可以看一下AN-1018: uC/OS-II and the ARM Cortex-M3 Processors
http://www.micrium.com/arm/
修正后的uC/OS-II Port里，OSCtxSw和OSIntCtxSw里都改用R0和R1，免除了保护R4和R5的麻烦，而且提高了任务切换的效率。

发表于 2008-4-11 11:31

谢谢提醒！

发表于 2008-4-11 12:41

刚才去下载了LS所提供的文档，查看OSCtxSw与OSIntCtxSw部分未见修正！
还是使用R4，R5寄存器！
LS是否提供一下已修改的文档！

发表于 2008-4-11 13:01

如下，使用R0和R1的话就不用保存了：

OSCtxSw
    LDR     R0, =NVIC_INT_CTRL                                  ; Trigger the PendSV exception (causes context switch)
    LDR     R1, =NVIC_PENDSVSET
    STR     R1, [R0]
    BX      LR

OSIntCtxSw
    LDR     R0, =NVIC_INT_CTRL                                  ; Trigger the PendSV exception (causes context switch)
    LDR     R1, =NVIC_PENDSVSET
    STR     R1, [R0]
    BX      LR

发表于 2008-4-11 13:51

发表于 2008-4-11 15:19

发表于 2008-4-16 16:50

发表于 2008-4-20 17:50

请问现在怎么下载啊谁能把文件重新发下

发表于 2008-4-23 00:39

因为QQ文件中转只有7天，所以现在文件已经不可下载！
如果有需要的TX可以留邮件地址即可！

发表于 2008-4-23 16:57

呵呵！

发表于 2008-4-24 19:44

能不能发一份给我学习一下
139520021@qq.com

发表于 2008-4-24 20:11

谢谢，yangxs1977@163.com

发表于 2008-5-16 11:03

lrzxc@163.com

发表于 2008-5-16 22:02

发表于 2008-5-17 00:42

yeswang1983@126.com

发表于 2008-5-17 14:53

ilymyhk@sohu.com

发表于 2008-5-19 09:23

楼主辛苦了。

好**，大家参与，！

呵呵，不客气！

Re

谢谢21楼，看来确实是我错了！

Re

是吗，不好意思，没有看到！

官方AN－1018文档未见修正这个问题！

官方已经修改了代码，但是没有更新文档说明！

我用freertos，做产品不要钱

留个记号，慢慢学习

回去试试

请问现在怎么下载啊 谁能把文件重新发下

需要文件的留个邮箱

好**，大家参与，！

能不能发一份给我学习一下

也给我发一份吧

给我也来一份吧，谢谢

楼上TX邮件已发，请查收！

能不能发一份给我学习一下

楼主辛苦了，请发我一份，多谢

多谢，已经收到邮件

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请问现在怎么下载啊谁能把文件重新发下