[Actel FPGA] GAL16V8编译问题?

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 楼主| nywjlwjh 发表于 2009-3-2 19:38 | 显示全部楼层 |阅读模式
用PROTEL&nbsp;DXP&nbsp;设计一GAL16V8电路,做一个基本的与非型RS触发器,若RS输出Q端接GAL16V8输出引脚,则编译正常;若输出再接其它单元,编译时出现错误提示。错误信息如下:<br />【Error】&nbsp;Free&nbsp;Documents.pld&nbsp;CUPL&nbsp;【0030ca】&nbsp;Intermediate&nbsp;dependent&nbsp;on&nbsp;itself:&nbsp;NetU10_I0&nbsp;02:57:30&nbsp;PM&nbsp;2009-3-2&nbsp;23&nbsp;<br /><br />不知是哪里出了问题?<br /><br />
徐若瑄 发表于 2009-3-3 09:08 | 显示全部楼层

是不是和外接單元沒有關係呢?

  
fpga-123 发表于 2009-3-3 17:47 | 显示全部楼层

外接电路不匹配?

  
蹦蹦车 发表于 2009-3-4 11:05 | 显示全部楼层

是在DXP中仿真的还是已经做成硬件了?

  
 楼主| nywjlwjh 发表于 2009-3-6 12:34 | 显示全部楼层

不会发图片,哪位帮忙?

  
 楼主| nywjlwjh 发表于 2009-3-6 22:37 | 显示全部楼层

在DXP中用原理图设计,编译时出现问题,无法生成*JED文件。

  
徐若瑄 发表于 2009-3-7 09:13 | 显示全部楼层

那就是说你在DXP进行仿真……这个真没有弄过

  
 楼主| nywjlwjh 发表于 2009-3-7 21:40 | 显示全部楼层

dxp做编程工具,没有仿真

  
小cat 发表于 2009-3-9 09:04 | 显示全部楼层

DXP还可以做编程工具?

  
徐若瑄 发表于 2009-3-10 10:24 | 显示全部楼层

DXP可以仿真,只是自己没有弄过而已。

  
 楼主| nywjlwjh 发表于 2009-3-12 22:04 | 显示全部楼层

图片再发一次

 楼主| nywjlwjh 发表于 2009-3-12 22:14 | 显示全部楼层

图片终于传上来了

说明:<br />上图中GAL16V8中2脚接点动按钮,6脚接启动按钮,8脚接停止按钮,13脚控制一电机。<br />上边图编译正常,生成的JED文件烧录后运行正常,下边的图编译时出现错误提示。错误信息如下:<br />【Error】&nbsp;Free&nbsp;Documents.pld&nbsp;CUPL&nbsp;【0030ca】&nbsp;Intermediate&nbsp;dependent&nbsp;on&nbsp;itself:&nbsp;NetU10_I0&nbsp;02:57:30&nbsp;PM&nbsp;2009-3-2&nbsp;23&nbsp;<br />
徐若瑄 发表于 2009-3-13 11:27 | 显示全部楼层

看见图了

  
 楼主| nywjlwjh 发表于 2009-3-13 22:58 | 显示全部楼层

图片已发,请高手给指点一下。

  
 楼主| nywjlwjh 发表于 2009-3-16 22:10 | 显示全部楼层

有了新进展

触发器/Q端接一个输出端就可以编译了,但不知为什么?我已没有多余的输出可以用了。
 楼主| nywjlwjh 发表于 2009-3-18 20:39 | 显示全部楼层

这个难道没人知道?

  
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