[Actel FPGA] 求助

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 楼主| 北京户口 发表于 2010-2-23 23:33 | 显示全部楼层 |阅读模式
对于core8051的仿真,我用试验的例程可以仿真,但是用自己建的工程和仿真文件就不能仿真,总是出现:
# Error loading design
# Error: Error loading design
#        Pausing macro execution
# MACRO ./run.do PAUSED at line 20


请问这是怎么回事啊?
想实习去 发表于 2010-2-23 23:34 | 显示全部楼层
你把全部的错误信息截取下来,这个问题可能是因为你的测试文件的模块不是命名为testbench引起的
米其林r 发表于 2010-2-24 00:07 | 显示全部楼层
同意楼上
 楼主| 北京户口 发表于 2010-2-24 13:02 | 显示全部楼层
祈求高手!
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