莱迪斯FPGA应用感想

发表于 2019-9-12 14:11

最近在用莱迪斯的器件，用原理图编程的，其中用到一个计数器，这个计数器有一个叫CI的输入引脚，在帮助文档中说这个引脚在计数器计数的时候是接高电平的，但是在原理图编程中这个CI引脚死活不让接高电平，这不是自相矛盾吗。莱迪斯的Diamond软件也很懵逼，本来调试好的某个组合逻辑是正常的，当其他组合逻辑有了修改重新综合后，本来正常的作何逻辑就不正常工作了。

发表于 2019-9-13 23:56

这家的就用过一次 diamond在线仿真等功能确实不好用
但原理图编程不知道是什么东西了

发表于 2019-9-23 09:54

用activehdl仿真查呀

发表于 2021-9-9 09:14

求资料共同学习进步，球球36351109.

发表于 2021-9-13 22:49

建议用HDL语言编写，在平台之间移植也方便。

[FPGA] 莱迪斯FPGA应用感想

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