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Xilinx v6系列dds IP核问题

2011-7-15 21:35

FPGA论坛
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rst是dds的 rst管脚

谢谢各位的帮忙，我再简化点说：就是想让8个dds同时输出，我的clk和数据信号都建立好了，然后吧rst信号从 ...

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