如何简化V6 DDR3控制器的使用－－转自FPGA版
2015-1-19 21:00
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猴哥，为什么要延迟一个节拍作为判断数据是否成功写入，直接用wdf_rdy_ns判断不就行了？将它引到端口输出 ...
猴哥，你说的那个FIFO我怎么没找到啊？
大神们，DDR3控制器有相应的规范标准吗？
2015-1-19 20:15
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嗯，我在看virtex-6的。
嗯，时序逻辑很简单，我现在就想设计控制器的架构，不知道有没有相关的标准？无从下手。。。 ...
自己写控制器
再加上项目背景。
想有点自己的东西，因为鄙人硕士毕设就是这个，怕不好毕业。我现在看的是赛灵思的。 ...
如题，小弟在看DDR3控制器，想自己做个控制器，不知道DDR3控制器有没有相应的规范标准？谢谢。
...
赛灵思DDR3控制器默认是随机读写吧？（一会读一会写）
2015-1-7 09:16
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有谁用过Xilinx Virtex-6的ddr3 ip 核
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