FPGA的普通I/O口用作时钟输入输出
2013-8-13 10:06
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我也跟着学习了
是不是做输出比较好啊？也不是很懂，帮你顶下，坐等高手，坐等猴哥了。
基于FPGA的UART控制器的实现
2013-8-9 14:25
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很好的**
基于FPGA的多路信号源设计与实现
2021-7-28 15:40
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感谢分享
基于FPGA的UART设计(转)
2013-8-9 13:30
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字好多
基于FPGA/CPLD设计与实现UART
2013-8-12 20:17
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有帮助。
关于PROCESS语句中敏感量问题，求证。
2013-8-2 22:43
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猴哥，您的最根本的原因，对我这个还没入门的小鸟来说，太抽象了:'(
哎呀呀，猴哥，俺想给你了，可是人家字打的比你多，哈哈哈哈哈。下次多弄点分给你哦，表桑心哈。:lol ...
十分感谢对新手的帮助结贴给分。望以后多多指教。
哎···那像我这种新手，大侠觉得应该怎么面对这个问题呢？我其实不懂电，大学专业是电脑编程，毕业后工 ...
大侠，不会吧，my god,我只是一个菜鸟，要不要上来就让我撞见这么难得问题哦。我用的编译器就是Quartus I ...
我是菜鸟问题比较基础，请大家指教。
问题一：
PROCESS(din)
BEGIN
IF(clk'EVENT AND clk='1' ) THEN
...
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