如何进行xilinxFPGA的后仿真
2012-12-29 23:42
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10楼的解释 只能说我们一般理解的不这么用
8楼的文档还是有用的
我搞定了 可以用生成的timesim 和sdf文件进 ...
先下载看看能不能
我是说 经过par之后的verilog文件怎么生成
如题 如果用altera的fpga，进行par之后 可以用quartus进行后仿真
但是ISE做par之后 xilinx的FPGA怎么进行后 ...
这三个按键怎么互锁，并且能输出端区分这三个按键
2012-6-13 12:53
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