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郁闷!资源装不下了。。。
2012-10-31 11:23
FPGA论坛
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5437
RAM用到>90%,LUT还要到80%,不容易布,建议把一些功能砍掉,省出lut试一下
verilog语言中always语句使用
2012-10-11 18:10
FPGA论坛
6
3490
答案当然是肯定的,lz看一下器件结构。。。
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