FPGA PCIe高性能加速平台 FPGA阵列 SRIO RapidIO 集成CPCIe/VPX系统
2020-5-27 12:28
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太厉害了 ，这个ddr可以这么用啊
chipscope的条件触发怎么用？
2018-1-9 19:07
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谢谢 代码设置都是对的 但chipscope没操作正确
先看设置代码：
assign c3_dbg_data[512:0] =
{487'b0,
cnt_y[9:0],
cnt_x[11:0],
hsync_d ...
Xilinx 在ISE已完成的工程文件中添加IP核
2018-1-14 21:13
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FPGA第一版
2018-3-9 22:56
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allegro报错
2018-2-9 12:33
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我需要设计FPGA板的大牛，有项目。
2018-5-27 22:40
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串口问题
2018-6-13 10:19
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这个共模抑制比怎么算
2018-12-12 20:27
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求Fedora14中的mesa-dri-drivers-7.9-1.fc14.i686
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原理图上一个端口有两个net label
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有4.4V单节锂电池充电电流为1.5A的充电IC
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