高速电路时序的计算

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 楼主| qianping1012 发表于 2013-6-5 09:15 | 显示全部楼层 |阅读模式
本帖最后由 qianping1012 于 2013-6-5 13:00 编辑

在高速电路的关键电路的设计中,关于满足时序要求的计算,我见到的就有好几个版本。不知道下面的方法,在设计高速电路
中可行吗



上面的方法摘自
http://www.docin.com/p-381991927.html

请大家给给建议。


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skm2008 发表于 2013-6-5 11:54 | 显示全部楼层
关于时序的计算,在芯片的手册中会进行说明
acute1110 发表于 2013-6-5 21:53 | 显示全部楼层
Hold与 setup 时间是基本要求。
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