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关于在传输过程中枚举失败的原因

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 楼主| gs850997871 发表于 2016-7-25 17:40 | 显示全部楼层 |阅读模式
FPGA, PGA, USB, PC通信, USB3.0
      利用USB3.0（cyusb3014）进行FPGA和PC通信，当FPGA的时钟偏高时，上位机软件就容易枚举不成功导致传输失败，这个怎么解决啊？有没有遇到过的/
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 楼主| gs850997871 发表于 2016-7-28 15:33 | 显示全部楼层
为什么FPGA通过USB给电脑端发递增数和递减数还不一样呢？递增数传输正常     递减数就不能正常传输  老是出错     这个是什么问题啊？不应该啊
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