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小弟不才，刚学FPGA，用了quartus下的Verilog，结果……

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 楼主| hit_hpc 发表于 2010-4-4 15:50 | 显示全部楼层 |阅读模式
Quartus, FPGA, verilog, ev, TI
指教啊
Error: Top-level design entity "lianxi" is undefined
这是什么错误呀！！！！！！
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相关帖子
wujing198 发表于 2010-4-4 19:10 | 显示全部楼层
工程名和顶层模块名不一致。
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lukyoo 发表于 2010-4-4 19:46 | 显示全部楼层
:$
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colinzhang 发表于 2010-4-5 17:00 | 显示全部楼层
上机第一天老师就反复提醒的一个地方，哈哈。
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shunlang 发表于 2010-4-5 23:09 | 显示全部楼层
2楼正解
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mydy2008 发表于 2011-1-2 14:47 | 显示全部楼层
同意楼上
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mydy2008 发表于 2011-1-2 14:47 | 显示全部楼层
同意楼上
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sxhhhjicbb 发表于 2011-2-19 23:09 | 显示全部楼层
文件名和模块名不一样
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taishan3703 发表于 2011-2-25 02:15 | 显示全部楼层
哈哈，看出来是刚学了。
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cooljoker 发表于 2011-2-26 15:27 | 显示全部楼层
还是自学的吧
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huajiandp 发表于 2011-2-28 10:11 | 显示全部楼层
。。。2楼正解。。。
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6673663king 发表于 2011-4-1 10:08 | 显示全部楼层
麻烦啊
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6673663king 发表于 2011-4-1 10:08 | 显示全部楼层
着玩真不容易学
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十字星1986 发表于 2011-4-1 13:20 | 显示全部楼层
开始总是不容易啊
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swbisheng_163 发表于 2011-4-2 22:34 | 显示全部楼层
同意楼上啊！
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xilinxic 发表于 2011-4-3 22:20 | 显示全部楼层
学到，受益。
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qq285226892 发表于 2011-4-6 23:05 | 显示全部楼层
开始用遇到问题肯定多，慢慢来就好。我这有详细的FPGA开发板的使用教程需要的话 可以发给你一份 285226892 qq.
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JLINGON 发表于 2011-4-10 08:02 | 显示全部楼层
工程名与实体名不一致
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utopiaworld 发表于 2011-4-10 23:24 | 显示全部楼层
点击这个文件用右键 ,把这个文件设置为顶层就可以了
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6673663king 发表于 2011-4-11 15:13 | 显示全部楼层
受教了
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