testbench出不来结果

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 楼主| yripple 发表于 2008-10-25 15:51 | 显示全部楼层 |阅读模式
//设计描述<br />`timescale&nbsp;1ns&nbsp;/&nbsp;1ps<br /><br />module&nbsp;compare(equal,a,b);<br />input&nbsp;a,b;<br />output&nbsp;equal;<br />assign&nbsp;equal=(a==b)?1:0;<br /><br />endmodule<br /><br />//测试代码<br />`timescale&nbsp;1ns&nbsp;/&nbsp;1ps<br />`include&nbsp;&quot;./compare.v&quot;<br />module&nbsp;testcompare_v;<br /><br />reg&nbsp;a,b;<br />wire&nbsp;equal;<br />compare&nbsp;m(.equal(equal),.a(a),.b(b));&nbsp;<br />initial<br />begin&nbsp;<br />a=0;<br />b=0;<br />#100&nbsp;a=0;b=1;<br />#100&nbsp;a=1;b=1;<br />#100&nbsp;a=1;b=0;<br />#100&nbsp;a=0;b=0;<br />#100&nbsp;$stop;<br />end<br />&nbsp;&nbsp;<br />endmodule<br /><br />语法没有错,可出来的波形不对,谁知道是什么原因?
lwf198305 发表于 2009-1-20 15:15 | 显示全部楼层

出口参数未定义

语句应该编译不通过,少了条语句,wire&nbsp;equal.用REG型更好
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