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IC设计

RTL设计、仿真、验证、综合、静态时序分析、等价性验证、FLOORPLAN、时钟树生成、DFT、低功耗设计、信号完整性等
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[cadence] Cadence.Allegro.and.OrCAD.v17.20(SPB)
jnaonaozth 2016-8-6 16:46 0 2786
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