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上升电平造成的？

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wanglaojii| | 2019-9-8 20:47 | 显示全部楼层 回帖奖励 |倒序浏览
如果全速仿真还是有异常的中断，可以单步执行，实时查看寄存器中标志位的的变化情况。
不用的I/O引脚尽量设置为输出为低电平，防止浮动引脚的异常干扰。。

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