STM32 的 SysTick 模块的时钟源

只看该作者 · 2025-1-24 12:03

STM32 的 SysTick 模块可以选择以下两种时钟源：

内核时钟 (HCLK)
- SysTick 使用 Cortex-M 内核的主时钟 (HCLK) 作为计数器的时钟源。
- 这种模式下，SysTick 的时钟频率与系统主时钟一致，能够提供更高的计时精度。
内核时钟的 8 分频 (HCLK/8)
- SysTick 的时钟频率为 HCLK 的 1/8。
- 这种模式下，计数器时钟速度降低，适用于较低速率的应用，特别是在低功耗模式下。

只看该作者 · 2025-1-24 12:04

时钟源选择方法SysTick 时钟源通过 SysTick 控制寄存器（CTRL） 的 CLKSOURCE 位（位2）选择：

CLKSOURCE = 1：选择内核时钟 (HCLK)。
CLKSOURCE = 0：选择内核时钟的 8 分频 (HCLK/8)。

时钟源对定时的影响假设主时钟 HCLK 为 72 MHz：

如果选择 HCLK 作为时钟源，则 SysTick 计数器的频率为 72 MHz。
如果选择 HCLK/8，则 SysTick 计数器的频率为 9 MHz。

由于 SysTick 是 24 位计数器，最大计数值为 2^24 - 1 (16,777,215)，所以最大定时周期为：

HCLK 模式：(2^24 - 1) / HCLK = (16,777,215) / 72,000,000 ≈ 0.23 秒
HCLK/8 模式：(2^24 - 1) / (HCLK / 8) = (16,777,215) / 9,000,000 ≈ 1.86 秒

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复制

#include "stm32f4xx.h"



void SysTick_ConfigWithClockSource(uint32_t ticks, uint8_t useHCLK) {

    SysTick->LOAD = ticks - 1;  // 设置重装载值

    SysTick->VAL = 0;           // 清零计数器



    if (useHCLK) {

        SysTick->CTRL |= SysTick_CTRL_CLKSOURCE_Msk;  // 使用 HCLK 作为时钟源

    } else {

        SysTick->CTRL &= ~SysTick_CTRL_CLKSOURCE_Msk; // 使用 HCLK/8 作为时钟源

    }



    SysTick->CTRL |= SysTick_CTRL_TICKINT_Msk |  // 使能中断

                     SysTick_CTRL_ENABLE_Msk;   // 启用 SysTick

}

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应用建议
如果需要高精度定时（如微秒级延时），推荐使用 HCLK 作为时钟源。
如果定时周期较长且精度要求不高，或系统频率较高时需节省功耗，可使用 HCLK/8。