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[开发生态]

单片机中的高阻态

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楼主: chenci2013
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41楼
claretttt| | 2025-3-19 15:47 | 只看该作者 回帖奖励 |倒序浏览
高阻态可以理解为一种特殊的电路状态，此时端口或引脚对外呈现出极高的电阻，几乎没有电流通过，既不输出高电平，也不输出低电平，仿佛与电路断开连接一样，但实际上它又并非真正的物理断开。在这种状态下，该引脚对其他电路部分的影响极小，就像处于一种 “悬浮” 的状态。比如，当单片机的某个 I/O 口设置为高阻态时，从该 I/O 口看进去，就好像连接了一个阻值极大的电阻，使得该端口在电路中几乎不参与电信号的传输和处理。

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42楼
abotomson| | 2025-3-20 09:01 | 只看该作者
当引脚处于高阻态时，如果没有合适的上拉或下拉电阻来固定其电压水平，那么这个引脚可能会受到外界噪声的影响而漂移不定，导致不可预期的行为。

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43楼
hearstnorman323| | 2025-3-20 10:45 | 只看该作者
处于高阻态的引脚允许外部电路对其进行控制或读取。因为引脚没有固定的输出电平，它能够接收来自外部电路的输入信号，并且其电平状态会随着外部输入的变化而变化。

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44楼
Moon月| | 2025-4-6 20:09 | 只看该作者
高阻态顾名思义就是电阻值很高。

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45楼
星闪动力| | 2025-4-7 10:15 | 只看该作者
高阻态像断开的开关，不导电，不干扰其他电路，用途多。

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46楼
未来AI| | 2025-4-8 09:45 | 只看该作者
高阻态就像引脚休息模式，不干扰电路，还能当输入用。

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47楼
AIsignel| | 2025-4-12 12:01 | 只看该作者
高阻态GPIO可能有漏电，设计时注意功耗。

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48楼
IntelCore| | 2025-4-12 21:43 | 只看该作者
先让引脚像没插线一样，再设为接收信号，这样就不会有残留电荷干扰采样结果了。

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49楼
yangxiaor520| | 2025-4-14 08:05 | 只看该作者
高阻态可以理解为开路状态吧

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50楼
zephyr9| | 2025-4-14 12:26 | 只看该作者
高阻态不耗电，也不影响别的东西，更安全。

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51楼
单芯多芯| | 2025-5-8 22:41 | 只看该作者
SCL和SDA线都应连接上拉电阻到VCC，确保总线稳定。

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52楼
dreamCar| | 2025-5-11 09:59 | 只看该作者
高阻输入就像一个超级挑剔的耳朵，只听不参与，对前级电路影响不大。

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53楼
理想阳| | 2025-5-11 21:12 | 只看该作者
拔掉引脚线，设为输入，消除残留电荷干扰。

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