求助:AXD无法使ARM进入调试状态,CPLD的错?

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 楼主| xszbuaa 发表于 2008-12-1 00:46 | 显示全部楼层 |阅读模式
  自己画的S3C2410的底板+外购的S3C2410的核心板,刚开始好好的,后来往2410连着的CPLD里下了几句极其简单的程序,就不能调试了,在ADS下一点出AXD,接着就会跳出错误提示的对话框:RDI&nbsp;severe&nbsp;Error&nbsp;00602&nbsp;:Can't&nbsp;halt&nbsp;target&nbsp;and&nbsp;make&nbsp;it&nbsp;enter&nbsp;DEBUG&nbsp;state&nbsp;(我用的是H_JTAG)。<br />  CPLD我用的是EPM7160S,它有6个全局输出使能信号,这些我没有理解,究竟是应该用verilog实现最终总的的输出使能信号呢还是在Quartus里设置一下就行,我没做任何处理。是不是CPLD影响了ARM的调试呢?<br />  请各位大虾指点,万分感谢!
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