一个关于pspice仿真的问题

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 楼主| wabjx 发表于 2010-12-11 22:46 | 显示全部楼层 |阅读模式
用pspice作模拟电路仿真的时候,那个输出引脚(比如运放)悬空的时候无法构建网络表,应该怎么处理呢,求指导
wangzhifenggsh 发表于 2013-8-1 14:39 | 显示全部楼层
加电阻,连接到地,构成信号回路
hyminzhu 发表于 2013-8-2 10:35 | 显示全部楼层
给一个参考电位就好了,具体设置要看芯片的具体要求
GoldSunMonkey 发表于 2013-8-2 20:49 | 显示全部楼层
GoldSunMonkey 发表于 2013-8-2 20:50 | 显示全部楼层
梅花望青竹 发表于 2013-8-2 23:49 | 显示全部楼层
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