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[FPGA] 全局时钟可配置

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 楼主| hnliucan520 发表于 2017-12-22 17:12 | 显示全部楼层 |阅读模式
时钟, DCM, FPGA, PGA, 引脚
是这样的，在现有的产品上，因为只有一个全局时钟引脚，但外部的时钟可在62M、80M、100M、125M切换，进入fpga内部通过DCM进行倍频，有什么办法能实现这样的切换么，因为全局时钟就只能有一个时序约束。
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