共射电路偏置部分的设计方法

登录 · 发表于 2021-6-23 15:39

QQ群里有位网友给出下图电路，其中是类似于MathCAD的数学软件辅助模拟电路设计以及计算的：

但是这个计算过程过于理想，基本上是教课书推导过程的逆过程。
下面谈谈正确的工程设计方法。

发表于 2021-6-23 15:55

本帖最后由 gaohq 于 2021-6-23 15:57 编辑

期待已久
如果是我设计的话，我就比较省事的搞法，把图中的R7和R2不要

登录 · 发表于 2021-6-23 16:58

本帖最后由 xukun977 于 2021-6-23 17:05 编辑

扯到5点10分，打卡下班

第一步，先用戴维南等效表示基极偏置网络：

第二步，我们可以算出所谓的静态工作点（VCE，IC）中的IC为：

大学教材中，晶体管的VBE是个定值，经常设为0.7V，而且β也是定值，教课书上喜欢取100.

这种好事，只能在教课书上看到，现实生活中，想都别想。

这里设β属于某个区间，例如可以是50到400，而且VBE也属于某个区间，例如0.4V到0.8V

登录 · 发表于 2021-6-23 17:09

本帖最后由 xukun977 于 2021-6-23 17:13 编辑

根据以上条件可知，当β取最小值，而VBE取最大值，此时IC取最小值，原因是显然的：

反之，当VBE取最小值，β取最大值时，IC取最大值。

又因为VCE=VCC-IC（RE+RC），所以VCE反比于IC，也就是说，上面第一种情形，IC取最小值时，VCE取最大值；第二种情形下，IC取最大值，VCE取最小值。

发表于 2021-6-23 18:16

算什么算，精算也不会准，工程设计就是拿电阻样本试

发表于 2021-6-23 19:48

wenleileilei 发表于 2021-6-23 18:16
算什么算，精算也不会准，工程设计就是拿电阻样本试

我的帖子不适合初学者看
出门左拐有B站，其中大约三分之一是讲古老的教课书上课视频，
另三分之一是电子爱好者玩玩电路仿真器的
其中大约十分之一是老外上课视频，这部分含金量高一些，但观众少的可怜。

登录 · 发表于 2021-6-23 22:59

为什么Ic相差这么大？

发表于 2021-6-24 18:07

顶一下

发表于 2021-6-24 21:40

captzs 发表于 2021-6-23 22:59
为什么Ic相差这么大？

两个电路参数一样，Ic相差这么大，如果不计算（仿真也是一种计算方法），如何知道工作点是否合适？是否超过ICM？

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