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lab里面提到的clock port在design中不存在
DesignckLabRTCtcl
新手园地 白板就是这个 2018-9-10 0 211 白板就是这个 2018-9-10 16:24
lock tree summary 和across clock tree summary 这两个summary的内容为何不一致?
osckACReport
新手园地 一片混沌 2018-9-10 0 252 一片混沌 2018-9-10 14:48
clock DAG 是什么缩写?
ckkd
新手园地 无幻 2018-9-10 0 193 无幻 2018-9-10 14:50
问report_ccopt_clock_trees -histograms这条命令显示的柱状图
AMSRAMReportSTck
新手园地 菊江先生 2018-9-10 0 293 菊江先生 2018-9-10 14:52
Fixing clock tree slew time and max cap violations和有何不同
IOviTIANck
新手园地 第8号打板工 2018-9-10 0 149 第8号打板工 2018-9-10 14:54
在哪找到我们需要clone的clock cell?
ckce
新手园地 大碴子味 2018-9-10 0 177 大碴子味 2018-9-10 14:56
Min、Max ID是负数是什么意思?sink没有落入skew约束中,对做clock tree的质量有没有影响? 新手园地 3月的尾巴 2018-9-10 0 159 3月的尾巴 2018-9-10 14:58
无法清除clock tree上的单元,无法合并clock gate CTS
TEckCONFIGeccReset
新手园地 你说说说说 2018-9-10 0 265 你说说说说 2018-9-10 15:02
为什么重置sdc时,只重置clock port呢?
sddcckClocksTE
新手园地 棋王高手 2018-9-10 0 410 棋王高手 2018-9-10 15:04
为什么dbSet selected.isDontTouch false后INV和gate还是dontTouch的状态?
TouchTEsesdck
新手园地 河童 2018-9-10 0 202 河童 2018-9-10 15:06
问布局初始化时,site_row、cell_site和track之间距离是在哪里定义的?
TrackTEckceAC
新手园地 追光少年 2018-9-10 0 380 追光少年 2018-9-10 15:12
hard blockage铺pg rail的原因
geckAISTdc
新手园地 丑帅丑帅的 2018-9-10 0 137 丑帅丑帅的 2018-9-10 15:30
"is_clock_used_as_clock" attribute含义
seckTEIOcollection
新手园地 スモモ 2018-9-10 0 579 スモモ 2018-9-10 15:38
place时的clock uncertainty和期望skew有关吗?
ckceAIACdes
新手园地 大碴子味 2018-9-10 0 164 大碴子味 2018-9-10 15:50
没有正确识别clock gating cell的问题
TIGatingckceTiming
新手园地 石头张 2018-9-10 0 269 石头张 2018-9-10 15:54
skew的约束跨gen clock吗?
GengeckTEdc
新手园地 roucun 2018-9-10 0 193 roucun 2018-9-10 15:58
virtual clock 作用
VirtualckseInputOutput
新手园地 丑帅丑帅的 2018-9-10 0 383 丑帅丑帅的 2018-9-10 16:26
异步时钟之间需要check,通过约束可以彻底消除亚稳态吗? 新手园地 白板就是这个 2018-9-10 0 256 白板就是这个 2018-9-10 16:30
跨时钟域scan chain 在 occ 滤出的两个function clock pulse下会不会有亚稳态问题?
CANfunctionPulse时钟ck
新手园地 电子学长 2018-9-10 0 288 电子学长 2018-9-10 16:32
DFT: OCC 插入
ckcodeLLCPLLshift
新手园地 社畜一枚 2018-9-10 0 629 社畜一枚 2018-9-10 16:36
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