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为何IO上的timing优化不如内部重要?
TimingTIIO时序芯片
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芯片功耗计算和低功耗设计概览中,请问clk gate, iso,rst,shutdowm的时序中,isolation和reset的顺序谁先谁后? 新手园地 那个叫黑的人 2018-9-11 0 307 那个叫黑的人 2018-9-11 08:24
什么是同步逻辑和异步逻辑? 新手园地 博斯 2018-9-11 0 355 博斯 2018-9-11 10:18
时序设计的实质是什么? 新手园地 小小的人呀 2018-9-11 0 398 小小的人呀 2018-9-11 10:28
时序约束的概念和基本策略是什么? 新手园地 电子学长 2018-9-11 0 208 电子学长 2018-9-11 10:36
说说静态、动态时序模拟的优缺点? 新手园地 第十代火影 2018-9-11 0 435 第十代火影 2018-9-11 11:16
决定最大时钟的因素以及表达式?
时钟tccksetup时序
新手园地 求关注啊 2018-9-11 0 248 求关注啊 2018-9-11 12:24
什么是同步逻辑和异步逻辑? 新手园地 菊江先生 2018-9-11 0 333 菊江先生 2018-9-11 13:22
[经验] 交织型采样ADC的基本原理 德州仪器模拟论坛 潜力变实力 2020-9-2 0 612 潜力变实力 2020-9-2 09:30
经典时序 attachment FPGA论坛 dameihuaxia 2020-9-9 0 441 dameihuaxia 2020-9-9 14:49
FPGA初学基础 attach_img EDA 技术 gaochy1126 2020-10-16 0 3249 gaochy1126 2020-10-16 20:34
F2812 for循环时序问题 求助
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德州仪器MCU 两只袜子 2020-11-5 0 598 两只袜子 2020-11-5 11:13
Xilinx的FPGA培训资料 attachment EDA 技术 gaochy1126 2020-11-13 0 354 gaochy1126 2020-11-13 10:25
12864学习笔记_5---12864液晶串行读写操作函数 德州仪器MCU classroom 2020-11-13 0 615 classroom 2020-11-13 11:22
FPGA中的时序约束的两种方法(主要针对IO延迟约束)
FPGAIO时序viVivado
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基于FPGA的线阵CCD驱动时序及模拟信号处理的设计.pdf attachment FPGA论坛 雷北城 2020-12-6 0 742 雷北城 2020-12-6 17:31
RGMII标准时序疑问 attach_img
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电子技术交流论坛 evechacha 2020-12-11 0 1034 evechacha 2021-2-5 14:15
saleae logic 怎么抓取分析QSPI 四线SPI时序呢 仪器仪表 xiaofei558008 2020-12-22 0 1315 xiaofei558008 2020-12-22 10:41
想做数字芯片设计前端?那你得了解这些事 attach_img 电子技术交流论坛 IC那些事儿 2020-12-22 0 1617 IC那些事儿 2020-12-22 18:05
数字IC后端设计介绍,写给哪些想转IC后端的人! attach_img 电子技术交流论坛 IC那些事儿 2020-12-29 0 1059 IC那些事儿 2020-12-29 11:55
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